Latch Transparent 3-ST 8-CH D-Type 20-Pin PDIP Magazine
| RoHS (Unione Europea) | Compliant |
| ECCN (Stati Uniti) | EAR99 |
| Stato del componente | Active |
| Codice HTS | 8542.39.00.60 |
| Automotive | No |
| PPAP | No |
| Type | D-Type |
| Logic Family | HC |
| Latch Mode | Transparent |
| Number of Channels per Chip | 8 |
| Number of Elements per Chip | 1 |
| Number of Inputs per Chip | 8 |
| Number of Input Enables per Element | 1 |
| Number of Selection Inputs per Element | 0 |
| Number of Outputs per Chip | 8 |
| Number of Output Enables per Element | 1 |
| Bus Hold | No |
| Set/Reset | No |
| Polarity | Non-Inverting |
| Maximum Propagation Delay Time @ Maximum CL (ns) | 150@2V|26@6V|30@4.5V |
| Absolute Propagation Delay Time (ns) | 225 |
| Process Technology | CMOS |
| Output Type | 3-State |
| Maximum Low Level Output Current (mA) | 7.8 |
| Maximum High Level Output Current (mA) | -7.8 |
| Minimum Operating Supply Voltage (V) | 2 |
| Typical Operating Supply Voltage (V) | 2.5|3.3|5 |
| Maximum Operating Supply Voltage (V) | 6 |
| Maximum Quiescent Current (uA) | 4 |
| Propagation Delay Test Condition (pF) | 150 |
| Minimum Operating Temperature (°C) | -40 |
| Maximum Operating Temperature (°C) | 85 |
| Packaging | Magazine |
| Mounting | Through Hole |
| Package Height | 3.5 |
| Package Width | 6.4 |
| Package Length | 25.1(Max) |
| PCB changed | 20 |
| Standard Package Name | DIP |
| Supplier Package | PDIP |
| Pin Count | 20 |
| Lead Shape | Through Hole |
| EDA / CAD Models |
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Latch Transparent 3-ST 8-CH D-Type 20-Pin PDIP Magazine
| RoHS (Unione Europea) | Compliant |
| ECCN (Stati Uniti) | EAR99 |
| Stato del componente | Active |
| Codice HTS | 8542.39.00.60 |
| Automotive | No |
| PPAP | No |
| Type | D-Type |
| Logic Family | HC |
| Latch Mode | Transparent |
| Number of Channels per Chip | 8 |
| Number of Elements per Chip | 1 |
| Number of Inputs per Chip | 8 |
| Number of Input Enables per Element | 1 |
| Number of Selection Inputs per Element | 0 |
| Number of Outputs per Chip | 8 |
| Number of Output Enables per Element | 1 |
| Bus Hold | No |
| Set/Reset | No |
| Polarity | Non-Inverting |
| Maximum Propagation Delay Time @ Maximum CL (ns) | 150@2V|26@6V|30@4.5V |
| Absolute Propagation Delay Time (ns) | 225 |
| Process Technology | CMOS |
| Output Type | 3-State |
| Maximum Low Level Output Current (mA) | 7.8 |
| Maximum High Level Output Current (mA) | -7.8 |
| Minimum Operating Supply Voltage (V) | 2 |
| Typical Operating Supply Voltage (V) | 2.5|3.3|5 |
| Maximum Operating Supply Voltage (V) | 6 |
| Maximum Quiescent Current (uA) | 4 |
| Propagation Delay Test Condition (pF) | 150 |
| Minimum Operating Temperature (°C) | -40 |
| Maximum Operating Temperature (°C) | 85 |
| Packaging | Magazine |
| Mounting | Through Hole |
| Package Height | 3.5 |
| Package Width | 6.4 |
| Package Length | 25.1(Max) |
| PCB changed | 20 |
| Standard Package Name | DIP |
| Supplier Package | PDIP |
| Pin Count | 20 |
| Lead Shape | Through Hole |
| EDA / CAD Models |
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