革新的なDSPLL® MultiSynthクロックアーキテクチャにより、高密度10/40/100Gラインカード設計が可能

ビデオストリーミングやクラウドコンピューティングなどをサポートするために帯域幅を拡大したいという需要が、より高速なネットワーク機器の開発を促進しています。既存のネットワーク インフラストラクチャを最大限に活用するために、新しい設計では、高速データ伝送と、より高いポート密度、およびOTNスイッチングとの機能統合を組み合わせています。この記事では、SkyworksのDSPLL® クロックが、最新の通信機器設計に任意の周波数、任意の出力のクロック合成を提供する方法について説明します。

OTNおよび10/40/100Gイーサネットでの簡素化されたクロック生成

Skyworksは、高速、周波数柔軟性、超低ジッタのクロック合成に最適化されたクロック ジェネレーターとジッタ アッテネータの新しいポートフォリオを開発しました。これらのクロック デバイスにより、システム設計者は、業界をリードするジッタ性能 (標準100 fs RMS未満 (12 kHz ~ 20 MHz)) を備えた「任意のポート、任意のプロトコル」のライン カードを設計できます。これらのデバイスは、「オンザフライ」周波数再構成もサポートします。この機能により、システム設計が大幅に簡素化され、SDN環境でのコストが大幅に削減され、より柔軟なサービス プロビジョニングが可能になります。サービス プロビジョニングにより、ネットワーク オペレーターは、クラウド ストレージ、ビデオ ストリーミング、モバイル サービスなど、さまざまな音声、ビデオ、データ サービスに対するユーザーの急速に変化する要求に対応できます。

第4世代DSPLLと従来の高性能クロック アーキテクチャの比較

Skyworks Si5345/44/42ジッタ減衰器は、従来のクロック アーキテクチャと比較して、周波数の柔軟性が向上し、ジッタと位相ノイズが低減し、スプリアス性能が向上した独自のアーキテクチャを活用しています。これらの新しいデバイスは、スタンドアロン クロック デバイス向けの最先端のプロセス テクノロジ (55 nm CMOS) を使用して設計されており、単一の統合アーキテクチャで比類のないパフォーマンスと周波数合成の柔軟性を実現できます。

第4世代DSPLLにより高ポート密度のライン カードが実現

次世代の10/40/100G OTNスイッチングおよび伝送機器は、ネットワーク容量をさらに拡張するために、より高いポート密度に移行しています。これにより、単一のICで複数の独立したPLLを提供し、密集した高密度のライン カードのPCBフットプリントを最小限に抑える、より高度に統合された物理層タイミング デバイスに対する市場のニーズが高まっています。第4世代DSPLLアーキテクチャはコンパクトでスケーラブルであり、競合ソリューションよりも大幅に小型でジッタが低いモノリシックなシングルチップ マルチPLLジッタ減衰クロックを構築できます。

結論

Skyworksの第4世代DSPLLクロックは、最先端のミックスドシグナル アナログ設計と55 nm CMOSテクノロジーを活用し、業界をリードするPLL統合とジッター性能を備えた任意の周波数、任意の出力のクロック合成を実現します。ハードウェア設計者は、これらの新製品を活用して、あらゆるプロトコル、あらゆるポート、高密度の10/40/100G OTNおよびイーサネット ライン カードを構築するために必要なタイミング コンポーネントのBOM数と複雑さを最小限に抑えることができます。

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