AD9559/PCBZ, Evaluation Board for Evaluating the AD9559 Clock Multiplier

Using Part

Fabricant

Analog Devices
  • Catégorie d'application
    Horloge et minuteur
  • Type de produit
    Horloge multiplexeur

Pour les produits finaux

  • Infrastructure
  • Networking
  • SONET/SDH
  • Wireless Base Station

Description

  • AD9559/PCBZ, Evaluation Board for the AD9559 is a low loop bandwidth clock multiplier that provides jitter cleanup and synchronization for many systems, including synchronous optical networks (SONET/SDH). The AD9559 generates two completely independent output clocks that are synchronized to up to four external input references. The digital PLL allows for reduction of input time jitter or phase noise associated with the external references. The digitally controlled loop and holdover circuitry of the AD9559 continuously generates a low jitter output clock even when all reference inputs have failed

Caractéristiques principales

  • Operating Frequency
    0.002 to 1250 MHz

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